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Verilog中ISE联合Modelsim仿真,出现蓝线和红线的问题

2017-12-10 00:15 363 查看
2017年12月10日  00:06

原因1:在仿真的时候,要选择需要进行仿真的文件,为test文件,如选到非test文件则会出现仿真出现蓝线和红线的问题。
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标签:  Verilog modelsim 仿真 FPGA