cadence学习:PCB布局基本知识简单介绍
2011-03-23 16:18
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调整元件主要用到的命令:Edit –Move Mirror Move命令里面包含旋转
1、 模拟电路和数字电路分区放置,中间可以留一定的空隙。数字电路部分的走线,不要穿越模拟电路部分
模拟:电源 运放 音频接口 数模转换
2、PLL对噪声敏感,需要局部去耦:加emi滤波器,电源从磁珠进来,经过EMI滤波器,再接电容,进入到Pll,这几个元件尽量靠近DSP,走线越短越好。另外,元件放置在同一层,不要经过过孔, 另外 ,走线一定从最小电容引脚出来,接到PLL上,其他局部去耦电路也一样,一定是从磁珠出来,依次经过大电容 小电容,最后从最小电容接到clock,电源走线一般加粗。
3、时钟部分,总线部分远离模拟部分
4、开关电源不能离运放太近,线性电源可以
5、干扰对慢速器件影响小,对高速影响大,因此可以把慢速器件放到高速和干扰之间,起到一定的隔离干扰的作用。
6、滤波电容的摆放,3.3V和1.2V交叉均匀摆放在周围,而且电容值越小的电容,距离DSP越近,因为电容都有一定的去耦半径。DSP芯片有些地方没有引脚,可以在这些地方放置最小的电容,通过过孔连接到电源层和地层;如果电容要摆几圈才能放下,注意电容值最小的在里面,大电容(储能电容)放到四个角上,尽量也近一些,大电容要求不是很高。
7、满足6的情况下,端接电阻(排阻)尽量靠近DSP.
1、 模拟电路和数字电路分区放置,中间可以留一定的空隙。数字电路部分的走线,不要穿越模拟电路部分
模拟:电源 运放 音频接口 数模转换
2、PLL对噪声敏感,需要局部去耦:加emi滤波器,电源从磁珠进来,经过EMI滤波器,再接电容,进入到Pll,这几个元件尽量靠近DSP,走线越短越好。另外,元件放置在同一层,不要经过过孔, 另外 ,走线一定从最小电容引脚出来,接到PLL上,其他局部去耦电路也一样,一定是从磁珠出来,依次经过大电容 小电容,最后从最小电容接到clock,电源走线一般加粗。
3、时钟部分,总线部分远离模拟部分
4、开关电源不能离运放太近,线性电源可以
5、干扰对慢速器件影响小,对高速影响大,因此可以把慢速器件放到高速和干扰之间,起到一定的隔离干扰的作用。
6、滤波电容的摆放,3.3V和1.2V交叉均匀摆放在周围,而且电容值越小的电容,距离DSP越近,因为电容都有一定的去耦半径。DSP芯片有些地方没有引脚,可以在这些地方放置最小的电容,通过过孔连接到电源层和地层;如果电容要摆几圈才能放下,注意电容值最小的在里面,大电容(储能电容)放到四个角上,尽量也近一些,大电容要求不是很高。
7、满足6的情况下,端接电阻(排阻)尽量靠近DSP.
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