6.S5PV210时钟初始化c语言实现代码
2017-08-16 16:02
211 查看
c语言实现时钟设置代码详解:
上一篇就是汇编实现时钟初始化的代码,这篇为c语言,前面的宏定义和汇编都是一样的。
// 时钟控制器基地址
#define ELFIN_CLOCK_POWER_BASE 0xE01000000
// 时钟相关的寄存器相对时钟控制器基地址的偏移值
#define APLL_LOCK_OFFSET 0x00
#define MPLL_LOCK_OFFSET 0x08
#define APLL_CON0_OFFSET 0x100
#define APLL_CON1_OFFSET 0x104
#define MPLL_CON_OFFSET 0x108
#define CLK_SRC0_OFFSET 0x200
#define CLK_SRC1_OFFSET 0x204
#define CLK_SRC2_OFFSET 0x208
#define CLK_SRC3_OFFSET 0x20c
#define CLK_SRC4_OFFSET 0x210
#define CLK_SRC5_OFFSET 0x214
#define CLK_SRC6_OFFSET 0x218
#define CLK_SRC_MASK0_OFFSET 0x280
#define CLK_SRC_MASK1_OFFSET 0x284
#define CLK_DIV0_OFFSET 0x300
#define CLK_DIV1_OFFSET 0x304
#define CLK_DIV2_OFFSET 0x308
#define CLK_DIV3_OFFSET 0x30c
#define CLK_DIV4_OFFSET 0x310
#define CLK_DIV5_OFFSET 0x314
#define CLK_DIV6_OFFSET 0x318
#define CLK_DIV7_OFFSET 0x31c
#define CLK_DIV0_MASK 0x7fffffff
// 上面这些都是我们下面用到的时钟设置相关的寄存器宏定义
// 结合之前的文章中关于时钟系统的框图我们来往寄存器写值
// 这三个宏可以让FOUTAPLL 输出1000MHz(值的相关设置我们可以参考S5PV210数据手册)
#define APLL_MDIV 0x7d
#define APLL_PDIV 0x3
#define APLL_SDIV 0x1
// 这三个宏可以让FOUTMPLL 输出667MHz
#define MPLL_MDIV 0x29b
#define MPLL_PDIV 0xc
#define MPLL_SDIV 0x1
// 这三个宏相当于将上面的宏定义值经过位或后合成一个值然后好写进响应的寄存器
// 里面相应的位设置可以查看相应寄存器。
#define set(mdiv,pdiv,sdiv) (1<<31 | mdiv<<16 | pdiv<<8 | sdiv)
#define APLL_VAL set_pll(APLL_MDIV | APLL_PDIV | APLL_SDIV)
#define MPLL_VAL set_pll(MPLL_MDIV | MPLL_PDIV | MPLL_SDIV)
// 定义宏然后通过指针的方式直接进行访问寄存器
#define REG_CLK_SRC0 (ELFIN_CLOCK_POWER_BASE + CLK_SRC0_OFFSET)
#define REG_APLL_LOCK (ELFIN_CLOCK_POWER_BASE + APLL_LOCK_OFFSET)
#define REG_MPLL_LOCK (ELFIN_CLOCK_POWER_BASE + MPLL_LOCK_OFFSET)
#define REG_CLK_DIV0 (ELFIN_CLOCK_POWER_BASE + CLK_DIV0_OFFSET)
#define REG_APLL_CON0 (ELFIN_CLOCK_POWER_BASE + APLL_CON0_OFFSET)
#define REG_MPLL_CON (ELFIN_CLOCK_POWER_BASE + MPLL_CON_OFFSET)
#define rREG_CLK_SRC0 (*(volatile unsigned int *)REG_CLK_SRC0)
#define rREG_APLL_LOCK (*(volatile unsigned int *)REG_APLL_LOCK)
#define rREG_MPLL_LOCK (*(volatile unsigned int *)REG_MPLL_LOCK)
#define rREG_CLK_DIV0 (*(volatile unsigned int *)REG_CLK_DIV0)
#define rREG_APLL_CON0 (*(volatile unsigned int *)REG_APLL_CON0)
#define rREG_MPLL_CON (*(volatile unsigned int *)REG_MPLL_CON)
void clock_init(void)
{
// 1 设置各种时钟开关,暂时不使用PLL
rREG_CLK_SRC0 = 0x0;
// 2 设置锁定时间,使用默认值即可
// 设置PLL后,时钟从Fin提升到目标频率时,需要一定的时间,即锁定时间
rREG_APLL_LOCK = 0x0000ffff;
rREG_MPLL_LOCK = 0x0000ffff;
// 3 设置分频
// 清bit[0~31]
rREG_CLK_DIV0 = 0x14131440;
// 4 设置PLL
// FOUT = MDIV*FIN/(PDIV*2^(SDIV-1))=0x7d*24/(0x3*2^(1-1))=1000 MHz
rREG_APLL_CON0 = APLL_VAL;
// FOUT = MDIV*FIN/(PDIV*2^SDIV)=0x29b*24/(0xc*2^1)= 667 MHz
rREG_MPLL_CON = MPLL_VAL;
// 5 设置各种时钟开关,使用PLL
rREG_CLK_SRC0 = 0x10001111;
}
上一篇就是汇编实现时钟初始化的代码,这篇为c语言,前面的宏定义和汇编都是一样的。
// 时钟控制器基地址
#define ELFIN_CLOCK_POWER_BASE 0xE01000000
// 时钟相关的寄存器相对时钟控制器基地址的偏移值
#define APLL_LOCK_OFFSET 0x00
#define MPLL_LOCK_OFFSET 0x08
#define APLL_CON0_OFFSET 0x100
#define APLL_CON1_OFFSET 0x104
#define MPLL_CON_OFFSET 0x108
#define CLK_SRC0_OFFSET 0x200
#define CLK_SRC1_OFFSET 0x204
#define CLK_SRC2_OFFSET 0x208
#define CLK_SRC3_OFFSET 0x20c
#define CLK_SRC4_OFFSET 0x210
#define CLK_SRC5_OFFSET 0x214
#define CLK_SRC6_OFFSET 0x218
#define CLK_SRC_MASK0_OFFSET 0x280
#define CLK_SRC_MASK1_OFFSET 0x284
#define CLK_DIV0_OFFSET 0x300
#define CLK_DIV1_OFFSET 0x304
#define CLK_DIV2_OFFSET 0x308
#define CLK_DIV3_OFFSET 0x30c
#define CLK_DIV4_OFFSET 0x310
#define CLK_DIV5_OFFSET 0x314
#define CLK_DIV6_OFFSET 0x318
#define CLK_DIV7_OFFSET 0x31c
#define CLK_DIV0_MASK 0x7fffffff
// 上面这些都是我们下面用到的时钟设置相关的寄存器宏定义
// 结合之前的文章中关于时钟系统的框图我们来往寄存器写值
// 这三个宏可以让FOUTAPLL 输出1000MHz(值的相关设置我们可以参考S5PV210数据手册)
#define APLL_MDIV 0x7d
#define APLL_PDIV 0x3
#define APLL_SDIV 0x1
// 这三个宏可以让FOUTMPLL 输出667MHz
#define MPLL_MDIV 0x29b
#define MPLL_PDIV 0xc
#define MPLL_SDIV 0x1
// 这三个宏相当于将上面的宏定义值经过位或后合成一个值然后好写进响应的寄存器
// 里面相应的位设置可以查看相应寄存器。
#define set(mdiv,pdiv,sdiv) (1<<31 | mdiv<<16 | pdiv<<8 | sdiv)
#define APLL_VAL set_pll(APLL_MDIV | APLL_PDIV | APLL_SDIV)
#define MPLL_VAL set_pll(MPLL_MDIV | MPLL_PDIV | MPLL_SDIV)
// 定义宏然后通过指针的方式直接进行访问寄存器
#define REG_CLK_SRC0 (ELFIN_CLOCK_POWER_BASE + CLK_SRC0_OFFSET)
#define REG_APLL_LOCK (ELFIN_CLOCK_POWER_BASE + APLL_LOCK_OFFSET)
#define REG_MPLL_LOCK (ELFIN_CLOCK_POWER_BASE + MPLL_LOCK_OFFSET)
#define REG_CLK_DIV0 (ELFIN_CLOCK_POWER_BASE + CLK_DIV0_OFFSET)
#define REG_APLL_CON0 (ELFIN_CLOCK_POWER_BASE + APLL_CON0_OFFSET)
#define REG_MPLL_CON (ELFIN_CLOCK_POWER_BASE + MPLL_CON_OFFSET)
#define rREG_CLK_SRC0 (*(volatile unsigned int *)REG_CLK_SRC0)
#define rREG_APLL_LOCK (*(volatile unsigned int *)REG_APLL_LOCK)
#define rREG_MPLL_LOCK (*(volatile unsigned int *)REG_MPLL_LOCK)
#define rREG_CLK_DIV0 (*(volatile unsigned int *)REG_CLK_DIV0)
#define rREG_APLL_CON0 (*(volatile unsigned int *)REG_APLL_CON0)
#define rREG_MPLL_CON (*(volatile unsigned int *)REG_MPLL_CON)
void clock_init(void)
{
// 1 设置各种时钟开关,暂时不使用PLL
rREG_CLK_SRC0 = 0x0;
// 2 设置锁定时间,使用默认值即可
// 设置PLL后,时钟从Fin提升到目标频率时,需要一定的时间,即锁定时间
rREG_APLL_LOCK = 0x0000ffff;
rREG_MPLL_LOCK = 0x0000ffff;
// 3 设置分频
// 清bit[0~31]
rREG_CLK_DIV0 = 0x14131440;
// 4 设置PLL
// FOUT = MDIV*FIN/(PDIV*2^(SDIV-1))=0x7d*24/(0x3*2^(1-1))=1000 MHz
rREG_APLL_CON0 = APLL_VAL;
// FOUT = MDIV*FIN/(PDIV*2^SDIV)=0x29b*24/(0xc*2^1)= 667 MHz
rREG_MPLL_CON = MPLL_VAL;
// 5 设置各种时钟开关,使用PLL
rREG_CLK_SRC0 = 0x10001111;
}
相关文章推荐
- 5.S5PV210 时钟初始化汇编代码
- 【回忆c语言】从指针的定义初始化到链表的插入删除排序实现code
- 希尔排序的c语言实现代码
- 用C语言代码实现n进制数转换为十进制数
- 数据结构 --静态队列的一个简单的C语言代码实现
- 基于C语言实现的扫雷游戏代码
- Sublime Text 3 实现C语言代码的编译和运行(示例讲解)
- C语言 编写代码实现,模拟用户登录场景 ( for循环,if语句的使用)
- 单位冲击响应与频响以及FIR实现代码(C语言)(转)
- c# winform时钟的实现代码
- [C语言教程]指针转换方式实现C语言的指针操作安全代码
- 用C语言开发一个BT下载软件 (四) ------ 代码实现-5-Peer管理模块
- 数据结构之队列的基本操作入队出队初始化删除-c++代码实现及运行实例结果
- 用C语言实现基于二叉搜索树的时钟管理程序
- Coursera deeplearning.ai 深度学习笔记2-1-Practical aspects of deep learning-神经网络实际问题分析(初始化&正则化&训练效率)与代码实现
- 排序算法之归并排序<Merge_Sort>及其C语言代码实现
- 使用C语言的libcurl库和cJSON库来在线查询CVE漏洞代码实现
- C语言简单实现sizeof功能代码
- Socket心跳包异常检测的C语言实现,服务器与客户端代码案例