cache一致性的问题
2013-06-06 10:04
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最近在调试TI的DM36x驱动,因为我们得通过FPGA往记录盘里写数据,因为数据量比较大,如果每一帧数据都通过write的方式进行,驱动会调用到
copy_from_user函数,这样对CPU性能以及带宽都是一个非常大的挑战!
后来改成内存映射的方式,mmap,看起来很简单的一个操作却折腾了好一阵子!
操作是这样的,首先,内核通过kmalloc操作得到一块连续的内存,然后通过vma—mmap操作把这块内心映射给用户层使用,
用户层通过一定的方式往这块内存写数据,大部分情况下,内核得到的数据是正确的,但是极少数情况,内核的数据和用户层数据不一致!
后来经过debug,得到是因为cache的原因,用户层数据和内核数据不一致!
其实,在内核里面我是做了pgprot_noncached操作的!
最后上网找到一篇博客:
/article/7830470.html
写得很详细,得调用
ioremap_nocache,内核读数据就直接为内存中的数据,而不是cache中的数据,这样数据就一致了
copy_from_user函数,这样对CPU性能以及带宽都是一个非常大的挑战!
后来改成内存映射的方式,mmap,看起来很简单的一个操作却折腾了好一阵子!
操作是这样的,首先,内核通过kmalloc操作得到一块连续的内存,然后通过vma—mmap操作把这块内心映射给用户层使用,
用户层通过一定的方式往这块内存写数据,大部分情况下,内核得到的数据是正确的,但是极少数情况,内核的数据和用户层数据不一致!
后来经过debug,得到是因为cache的原因,用户层数据和内核数据不一致!
其实,在内核里面我是做了pgprot_noncached操作的!
最后上网找到一篇博客:
/article/7830470.html
写得很详细,得调用
ioremap_nocache,内核读数据就直接为内存中的数据,而不是cache中的数据,这样数据就一致了
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